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一般同步時(shí)鐘的精度外時(shí)鐘≥線路提取時(shí)鐘≥內(nèi)部自由鐘。
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各網(wǎng)絡(luò)節(jié)點(diǎn)同步輸入接口應(yīng)接受來自局內(nèi)BITS設(shè)備不同輸出模塊的兩路定時(shí)信號,采用一主一備外定時(shí)信號方式。
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在制定本地BITS設(shè)備輸出端口分配方案時(shí),應(yīng)避免出現(xiàn)定時(shí)環(huán)路,包括主、備用定時(shí)基準(zhǔn)鏈路倒換時(shí)不應(yīng)構(gòu)成定時(shí)環(huán)路。
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